基于FPGA的IDE硬盤數(shù)據(jù)AES加解密研究與實現(xiàn)
陳燈川，馬維華，張有成
摘要： 提出了基于FPGA對IDE硬盤數(shù)據(jù)進(jìn)行AES加解密的方法。對算法進(jìn)行了改進(jìn)和優(yōu)化，以降低加解密過程對IDE硬盤數(shù)據(jù)傳輸速度的影響。
Abstract：
Key words :
摘要：提出了基于FPGA" title="FPGA">FPGA對IDE" title="IDE">IDE硬盤數(shù)據(jù)進(jìn)行AES" title="AES">AES加解密的方法。對算法進(jìn)行了改進(jìn)和優(yōu)化，以降低加解密過程對IDE硬盤數(shù)據(jù)傳輸速度的影響。
關(guān)鍵詞：FPGA AES IDE
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