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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問題，設(shè)備可以在那里重新編程。

Cypress CY8C52 超低功耗PSoC系列開發(fā)方案

Cypress公司的CY8C52超低功耗PSoC系列采用32位PSoC5平臺(tái),在CPU子系統(tǒng)周圍提供了可編程的數(shù)字,模擬和互連區(qū)塊.它的32位ARMCortex-M3CPU核工作在DC-40MHz,閃存程序存儲(chǔ)器高達(dá)256KB,SRAM存儲(chǔ)器高達(dá)64KB,2KBEEPROM,有多層AHB總線接入的24路DMA,工作電壓0.5V到5.5V,可以廣泛應(yīng)用在消費(fèi)類電子,工業(yè)控制和醫(yī)療設(shè)備等各種領(lǐng)域.

發(fā)表于：1/6/2012

PCB板中EMC/EMI的設(shè)計(jì)技巧

隨著IC器件集成度的提高、設(shè)備的逐步小型化和器件的速度愈來愈高，電子產(chǎn)品中的EMI問題也更加嚴(yán)重。從系統(tǒng)設(shè)備EMC/EMI設(shè)計(jì)的觀點(diǎn)來看，在設(shè)備的PCB設(shè)計(jì)階段處理好EMC/EMI問題，是使系統(tǒng)設(shè)備達(dá)到電磁兼容標(biāo)準(zhǔn)最有效、成本最低的手段。本文介紹數(shù)字電路PCB設(shè)計(jì)中的EMI控制技術(shù)。

發(fā)表于：1/6/2012

用CPLD 實(shí)現(xiàn)本安型礦用數(shù)據(jù)采集系統(tǒng)

實(shí)現(xiàn)了基于CPLD 的本安型礦用數(shù)據(jù)采集系統(tǒng)。系統(tǒng)利用CPLD 可編程邏輯器件的模塊化設(shè)計(jì)思想,結(jié)合礦用設(shè)備信號(hào)處理本安型的行業(yè)要求，使用CPLD 可編程邏輯器件完成了開關(guān)量信號(hào)輸入、輸出和頻率模擬量輸入工作。由于設(shè)計(jì)中可進(jìn)行邏輯仿真，從而保證了設(shè)計(jì)的正確性，縮短了產(chǎn)品開發(fā)周期，簡化了硬件設(shè)計(jì)，為產(chǎn)品贏得市場(chǎng)爭取了時(shí)間。

發(fā)表于：1/6/2012

基于EP9312的金融嵌入式系統(tǒng)實(shí)現(xiàn)方案

闡述了采用EP9312來構(gòu)造銀行稅務(wù)類嵌入式系統(tǒng)的理由，將EP9312與其它嵌入式處理器進(jìn)行了比較。根據(jù)EP9312的特點(diǎn)和系統(tǒng)需求，提出了一種基于EP9312的嵌入式系統(tǒng)硬件設(shè)計(jì)方案。介紹了系統(tǒng)的技術(shù)指標(biāo)及其所使用的Super I/O、PHY、接口電平轉(zhuǎn)換器、Flash、SDRAM、Boot-loader等各組成部分。該系統(tǒng)主要應(yīng)用于高端打印機(jī)、計(jì)算機(jī)終端和高端收款機(jī)等產(chǎn)品。

發(fā)表于：1/5/2012

基于FPGA的電梯控制系統(tǒng)設(shè)計(jì)

摘要：介紹了基于FPGA的四層電梯控制系統(tǒng)的設(shè)計(jì)。該系統(tǒng)采用Altera公司的CycloneⅡ系列FPGA芯片EP2C5T144作為主控制芯片，采用Verilog-HDL編程描述，實(shí)現(xiàn)對(duì)電梯的智能控制，經(jīng)仿真驗(yàn)證，完成所要求功能。該設(shè)計(jì)采用模

發(fā)表于：1/5/2012

FPGA異步時(shí)鐘設(shè)計(jì)中的同步策略

基于FPGA的數(shù)字系統(tǒng)設(shè)計(jì)中大都推薦采用同步時(shí)序的設(shè)計(jì)，也就是單時(shí)鐘系統(tǒng)。但是實(shí)際的工程中，純粹單時(shí)鐘系統(tǒng)設(shè)計(jì)的情況很少，特別是設(shè)計(jì)模塊與外圍芯片的通信中，跨時(shí)鐘域的情況經(jīng)常不可避免。

發(fā)表于：1/5/2012

約束、時(shí)序分析的概念介紹

很多人詢問關(guān)于約束、時(shí)序分析的問題，比如：如何設(shè)置setup，hold時(shí)間？如何使用全局時(shí)鐘和第二全局時(shí)鐘（長線資源）？如何進(jìn)行分組約束？如何約束某部分組合邏輯？如何通過約束保證異步時(shí)鐘域之間的數(shù)據(jù)交換可靠？如何使用I/O邏輯單元內(nèi)部的寄存器資源？

發(fā)表于：1/5/2012

應(yīng)用于倍頻電路的吞脈沖分頻器設(shè)計(jì)

分析了應(yīng)用于倍頻電路的吞脈沖分頻器的工作原理，建立了基于Simulink和FPGA的分頻器模型。實(shí)驗(yàn)結(jié)果表明，該分頻器可以實(shí)現(xiàn)雙模分頻功能，并能大幅度降低數(shù)字電路的功耗，為開發(fā)實(shí)用倍頻電路提供了可行途徑。

發(fā)表于：1/4/2012

M4K塊移位寄存器數(shù)據(jù)讀進(jìn)方式的邏輯分析儀設(shè)計(jì)

采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片，QuartusⅡ?yàn)檐浖脚_(tái)，用硬件描速語言設(shè)計(jì)了一個(gè)具有變頻采樣時(shí)鐘和16路采樣通道，基于VGA顯示的邏輯分析僅．該設(shè)計(jì)方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進(jìn)行讀進(jìn)數(shù)據(jù)的方式，提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實(shí)現(xiàn)簡單，價(jià)格低，具有較高的使用價(jià)值。

發(fā)表于：1/4/2012

基于Xilinx System Generator的PID算法快速硬件實(shí)現(xiàn)

介紹了利用Xilinx System Generator平臺(tái)構(gòu)建模型化數(shù)字PID控制算法，并通過FPGA將數(shù)字PID算法結(jié)合傳感器與實(shí)際硬件控制對(duì)象快速建立控制模型，構(gòu)成完整的閉環(huán)控制。通過對(duì)控制效果的實(shí)驗(yàn)驗(yàn)證,證明了其控制方法的可行性。

發(fā)表于：1/4/2012