文獻(xiàn)標(biāo)識(shí)碼: A
DOI:10.16157/j.issn.0258-7998.211960
中文引用格式: 劉濤,宗艷艷,王乾輝,等. 基于PCIe Gen5的低成本Coupon設(shè)計(jì)[J].電子技術(shù)應(yīng)用,2022,48(6):116-120.
英文引用格式: Liu Tao,Zong Yanyan,Wang Qianhui,et al. Low-cost Coupon design based on PCIe Gen5 signal[J]. Application of Electronic Technique,2022,48(6):116-120.
0 引言
互聯(lián)網(wǎng)技術(shù)飛速發(fā)展,萬物高速互連早已成為不可逆轉(zhuǎn)的發(fā)展趨勢(shì),為了滿足日益增長(zhǎng)的數(shù)據(jù)存儲(chǔ)、傳輸與交換需求,信號(hào)速率也正在以前所未有的速度進(jìn)行升級(jí)換代,以服務(wù)器系統(tǒng)中代表性的PCIe總線為例,信號(hào)經(jīng)歷了從第一代產(chǎn)品的2.5 Gb/s速率,到如今主推的第五代32 Gb/s速率,乃至即將發(fā)行的第六代64 Gb/s速率的飛速革新[1]。盡管速率提升可以有力推動(dòng)數(shù)字技術(shù)發(fā)展,卻也帶來了一系列的困難和挑戰(zhàn),對(duì)于SI工程師來說,如何在高度集成的復(fù)雜電子系統(tǒng)中保證高速信號(hào)質(zhì)量,完成信號(hào)完整性設(shè)計(jì),成為了越來越突出的重難點(diǎn)問題。
所謂信號(hào)完整性設(shè)計(jì),就是要對(duì)引起高速信號(hào)失真的各種因素進(jìn)行優(yōu)化,盡量減少信號(hào)失真,保證其能準(zhǔn)確傳遞信息。引起信號(hào)失真的因素主要包括信號(hào)網(wǎng)絡(luò)之間產(chǎn)生的串?dāng)_問題,以及信號(hào)自身傳輸媒介引起的反射和損耗問題[2]。因?yàn)閭鬏斅窂酱嬖诘刃Т?lián)和并聯(lián)電阻,信號(hào)在此媒介中傳輸時(shí)必然會(huì)有一定的能量損耗,通常高頻分量損耗比低頻分量大,導(dǎo)致了信號(hào)上升邊退化現(xiàn)象,引起符號(hào)間干擾(ISI)和眼圖塌陷等一系列問題[3]。新一代服務(wù)器產(chǎn)品中,PCIe Gen5信號(hào)速率高達(dá)32 Gb/s,損耗引起的上升邊退化問題尤為嚴(yán)重,必須進(jìn)行優(yōu)化設(shè)計(jì)。
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作者信息:
劉 濤,宗艷艷,王乾輝,秦玉倩,田民政,余華國
(浪潮電子信息產(chǎn)業(yè)股份有限公司,山東 濟(jì)南250101)