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EDA工具-Mentor Graphics
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EDA工具-Cadence
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半導(dǎo)體科普：IC 功能的關(guān)鍵，復(fù)雜繁瑣的芯片設(shè)計流程
發(fā)表于：8/3/2015 9:43:00 AM
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EDA產(chǎn)業(yè)高齡化？沒那么嚴重啦！
發(fā)表于：7/1/2015 10:10:00 AM
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Mentor Graphics發(fā)布《汽車系統(tǒng)與線束設(shè)計的自動短路試驗》報告
發(fā)表于：6/30/2015 1:22:00 AM
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Proteus軟件概述及功能
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Proteus軟件簡介
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AWR宣布2013西安電子科技大學(xué)學(xué)生設(shè)計競賽獲獎名單及獎品
發(fā)表于：12/26/2013 10:09:29 AM
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Altium將原生3D PCB的ECAD與MCAD集成提升到新高度
發(fā)表于：8/15/2013 11:29:10 AM
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新的工具可簡化FPGA綜合
發(fā)表于：8/5/2013 3:03:43 PM
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Mentor Graphics與寧波諾丁漢大學(xué)（UNNC）建立集成電路聯(lián)合實驗室
發(fā)表于：4/15/2013 4:24:01 PM
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第八屆Synopsys亞美尼亞國際微電子奧林匹亞競賽拉開帷幕
發(fā)表于：3/29/2013 3:12:25 PM
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功率：EDA設(shè)計中的巨大挑戰(zhàn)
發(fā)表于：12/25/2012 2:26:00 PM
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第七屆Synopsys亞美尼亞國際微電子奧林匹亞競賽圓滿結(jié)束
發(fā)表于：10/12/2012 9:00:20 AM
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Synopsys并購帶動EDA產(chǎn)業(yè)重回制造懷抱？
發(fā)表于：8/8/2012 12:00:00 AM
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科通集團參加2012 Cadence用戶大會-CDNLive，助力本土EDA設(shè)計水平提升
發(fā)表于：7/31/2012 1:40:38 PM
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基于CPLD的智能撥號報警系統(tǒng)
發(fā)表于：7/23/2012 4:54:00 PM
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基于Astro工具的ASIC時序分析
發(fā)表于：7/23/2012 2:06:02 PM
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基于ESL并采用System C和System Verilog的設(shè)計流程
發(fā)表于：7/23/2012 2:04:03 PM
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驅(qū)動集成電路功率級中瞬態(tài)問題的處理
發(fā)表于：7/5/2012 4:21:39 PM
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基于EDA的數(shù)據(jù)傳輸系統(tǒng)的HDB3編碼器設(shè)計
發(fā)表于：6/28/2012 10:59:22 AM
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基于CPLD的數(shù)字電路設(shè)計
發(fā)表于：6/5/2012 2:55:10 PM
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PSoC的繼承開發(fā)環(huán)境與開發(fā)關(guān)鍵
發(fā)表于：5/11/2012 2:19:14 PM
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PCB設(shè)計之特殊元件布局
發(fā)表于：4/9/2012 8:54:49 AM
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SpringSoft推出第三代偵錯平臺Verdi3,大幅提高驗證生產(chǎn)力
發(fā)表于：3/8/2012 12:11:02 PM
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基于EDA技術(shù)的數(shù)字系統(tǒng)設(shè)計
發(fā)表于：3/1/2012 2:34:34 PM
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精確計算整流器的輸入電容
發(fā)表于：2/10/2012 3:14:39 PM
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采用EDA或FPGA實現(xiàn)IP保護
發(fā)表于：2/10/2012 10:40:30 AM
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基于EDA技術(shù)的FPGA設(shè)計
發(fā)表于：1/10/2012 3:22:49 PM
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基于FPGA的錯誤檢測與自動糾正的設(shè)計實現(xiàn)
發(fā)表于：1/7/2012 2:01:08 PM
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