基于先進(jìn)CMOS工藝的多通道Gbps LVDS接收器
所屬分類：技術(shù)論文
上傳者：wwei
文檔大?。?span>205 K
標(biāo)簽： 模數(shù)轉(zhuǎn)換器 多通道LVDS 鎖相環(huán)
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文檔介紹：在SIP（System In a Package）系統(tǒng)中集成具有LVDS（Low-Voltage Differential Signal）接口的多通道高速模數(shù)轉(zhuǎn)換器（Analog-to-Digital Converter，ADC）時(shí)，面臨不同LVDS輸出通道延時(shí)不同所導(dǎo)致的數(shù)據(jù)采集錯(cuò)誤的問題，為此設(shè)計(jì)了一個(gè)多通道自適應(yīng)LVDS接收器。通過采用數(shù)據(jù)時(shí)鐘恢復(fù)技術(shù)產(chǎn)生一個(gè)多相位的采樣時(shí)鐘，并結(jié)合ADC的測試模式來確認(rèn)每一個(gè)通道的采樣相位，能夠自動對每一個(gè)通道的延時(shí)分別進(jìn)行調(diào)整，以達(dá)到對齊各通道采樣相位點(diǎn)，保證數(shù)據(jù)正確采集的目的。最后，基于先進(jìn)CMOS工藝進(jìn)行了接收器的設(shè)計(jì)、仿真、后端設(shè)計(jì)實(shí)現(xiàn)和流片測試，仿真和流片后的板級測試結(jié)果均表明該接收器能夠?qū)νǖ姥舆t進(jìn)行自動調(diào)節(jié)以對齊采樣相位，且最大的采樣相位調(diào)節(jié)范圍為±3 bit，信噪比大于65 dB，滿足了設(shè)計(jì)要求和應(yīng)用需求。
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